Articulo de referencia

Cobertura de fallas

La cobertura de fallos se refiere al porcentaje de fallos detectados durante la prueba de cualquier sistema diseñado. Una alta cobertura de fallos es especialmente valiosa duran...

La cobertura de fallos se refiere al porcentaje de fallos detectados durante la prueba de cualquier sistema diseñado. Una alta cobertura de fallos es especialmente valiosa durante las pruebas de fabricación, y para aumentarla se utilizan técnicas como el Diseño para la Prueba (DFT) y la generación automática de patrones de prueba .

Aplicaciones

electrónica digital

En electrónica digital , la cobertura de fallos se refiere a la cobertura de fallos fijos . [ 1 ] Se mide fijando cada pin del modelo de hardware en lógica '0' y lógica '1', respectivamente, y ejecutando los vectores de prueba. Si al menos una de las salidas difiere de lo esperado, se dice que se ha detectado el fallo. Conceptualmente, el número total de ejecuciones de simulación es el doble del número de pines (ya que cada pin se fija de una de dos maneras, y ambos fallos deben detectarse). Sin embargo, existen muchas optimizaciones que pueden reducir el cálculo necesario. En particular, a menudo se pueden simular muchos fallos no interactivos en una sola ejecución, y cada simulación puede terminarse tan pronto como se detecte un fallo.

Una prueba de cobertura de fallos se supera cuando se detecta al menos un porcentaje específico de todos los fallos posibles. Si no se supera, existen al menos tres opciones. En primer lugar, el diseñador puede ampliar o mejorar el conjunto de vectores, por ejemplo, utilizando una herramienta de generación automática de patrones de prueba más eficaz . En segundo lugar, se puede redefinir el circuito para mejorar la detectabilidad de fallos (mejor controlabilidad y observabilidad). En tercer lugar, el diseñador puede simplemente aceptar la menor cobertura.

Véase también

Referencias

  1. Williams, Thomas W.; Sunter, Stephen K. (2000). ¿Cómo debería definirse la cobertura de fallos? . 18º Simposio de Pruebas VLSI del IEEE (VTS 2000), 30 de abril - 4 de mayo de 2000, Montreal, Canadá. pp. 325– 328. doi : 10.1109/VTS.2000.10003 . 
  • Pruebas del simulador de fallos a nivel de compuerta para instituciones educativas sin fines de lucro de la Universidad de Illinois
  • AUSIM, un simulador de fallos jerárquico y gratuito de la Universidad de Auburn, se encuentra archivado el 24 de abril de 2021 en la Wayback Machine.
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